フローティングゲートを用いるアナログ積和演算回路の集積度について
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概要
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イメージセンサに演算機能等を付加することでシステム全体の性能向上を図る方式はインテリジェント・センサまたはビジョンチップなどと呼ばれ、例えばセンサ上で画像入力と同時に高速な並列画像処理を実行するチップがすでに検討・試作されている。こうしたチップでは画素単位に演算回路を持たせて完全な並列処埋を実現しており、我々は、このための基本演算回路として差動増幅器とフローティングゲートの組合せによる積和演算器を提案している。最近、プロトタイプ・チップを製作する機会を得てレイアウト作業を行ったところであるが、今回はその結果を踏まえて実際に実現可能な集積度について検討したので、報告する。
- 社団法人電子情報通信学会の論文
- 1997-08-13
著者
-
松本 隆
早稲田大学大学院理工学研究科
-
松本 隆
早稲田大学先進理工学学術院 電気・情報生命工学科
-
坂井 丈泰
早稲田大学理工学総合研究センター
-
坂井 丈泰
運輸省 電子航法研究所
-
国島 貴志
早稲田大学 理工学部 電気電子情報工学科
-
永井 宏昌
早稲田大学 理工学部 電気電子情報工学科
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