フローティングゲートを用いるアナログ積和演算回路の演算精度向上について
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概要
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イメージセンサの高性能化が進められる一方, センサ自体に演算機能等を付加することによりシステム全体の高性能化を図る方式が検討されるようになってきている。こうした試みはインテリジェント・センサまたはビジョンチップなどと呼ばれ, 例えばセンサ上で画像入力と同時に高速な並列画像処理を実行するチップがすでに検討・試作されている。こうしたチップでは, 各画素単位に演算回路を持たせて完全な並列処理を実現しているが, 集積度を高めるため演算方式はアナログ回路によることが多い。我々は, このための基本演算回路として, 差動増幅器とフローティングゲートの組み合わせによる積和演算器を提案している。今回はリセット回路にさらに検討を加え, 演算精度を向上することを考えたので報告する。
- 社団法人電子情報通信学会の論文
- 1997-03-06
著者
-
松本 隆
早稲田大学大学院理工学研究科
-
松本 隆
早稲田大学先進理工学学術院 電気・情報生命工学科
-
坂井 丈泰
早稲田大学理工学総合研究センター
-
坂井 丈泰
運輸省電子航法研究所
-
永井 宏昌
早稲田大学 理工学部 電気電子情報工学科
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