アナログ定係数乗算器アレイによる離散フーリエ変換VLSIの構成
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概要
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アナログ回路をVLSI上で並列に動作させ、離散フーリエ変換(DET)を高速に実行する手法を提案する。MOSカレントミラーで定係数乗算器を構成し、電流モードで動作させる。これによって、DFTの基本演算である定係数と入力信号との積和演算を簡単な構成により実現できる。このようなアナログDFT-VLSIの構成として、2次元乗算器アレイ、FFT型の構成、1次元乗算器アレイによる方法が考えられるが、この中で比較的実現が容易であり、演算精度の点でも有利な一次元乗算器アレイによる方法に関して具体的な構成を検討した。その結果1024点のDFT-VLSIとして、演算時間約220μs、演算誤差の標準偏差約2%程度のものが実現できることが予測された。
- 1994-06-23
著者
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