低消費電力・低リーク電流CMOS平方根回路(VLSI回路, デバイス技術(高速・低電圧・低消費電力))
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概要
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CMOS平方根回路の低消費電力化を目的に、平方根アルゴリズム、回路アーキテクチャを開発、改良し、総論理ゲート数、クリティカルパスゲート段数を1/2以下に削減した.また、リーク電流を大幅に削減するために、CMOSスイッチ2個で構成される電圧レベル変換(SVL)回路を採用した.この結果、8-bit入力、4-bit出力平方根回路の動作時消費電力、待機時消費電力は削減され、それぞれ132μW、34nWとなった.これらは従来形平方根回路のそれぞれ27.3%、3%であった.
- 社団法人電子情報通信学会の論文
- 2005-08-11
著者
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