キャッシュ及びタグを搭載した32バンク構成の256Mb DRAM
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概要
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125Mバイト, 秒シンクロナス動作の32バンク構成256Mb DRAMを開発した。シェアドセンスアンプを用いるキャッシュ,ロウデコーダ埋め込みタグ,バンクのオーバラップ動作制御を特徴とする多バンクアーキテクチャを採用した。また、複数信号の位相差を用いるタイミングパルス伝送手法と電圧制御負性コンダクタンス回路を備えるデータバス電流センスアンプにより,125MHzのシンクロナス動作を実現した。
- 1994-05-27
著者
-
田野井 聡
沖電気工業
-
田中 泰廣
沖電気工業
-
田邉 哲也
沖電気工業
-
北 明夫
沖電気工業
-
稲田 俊夫
沖電気工業
-
浜崎 良二
沖電気工業
-
大槻 欣男
沖電気工業
-
上杉 勝
沖電気工業
-
田野井 聡
沖電気工業株式会社
-
田邉 哲也
沖電気工業株式会社
-
上杉 勝
沖電気工業株式会社
-
大槻 欣男
沖電気工業株式会社
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