SD数演算を用いた2進浮動小数点加算回路の構成
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概要
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従来の2進数演算に基づく浮動小数点演算システムでは、2の補数表現を用いて加減算を行っている。加減算の演算数の仮数部は絶対値と符号からなるため、演算数の順番の入れ換えや加算における桁上げ伝搬は演算の速度を制限してしまう。本論文では、2進SD(Signed-Digit)数演算を導入することにより、従来の方法における演算数の入れ換え及び桁上げによる演算制限を軽減させ、高速な2進浮動小数点加算回路を実現するのを目的とする。提案する浮動小数点加算回路の内部はSD数加算回路を中心とした構成になるが、外部の入出力数表現は従来の2進小数点数表現を用いる。そのために、効率的な丸め及びSD数-2進数変換回路を提案する。 VHDLによる回路設計及びシミュレーションを行い、従来の浮動小数点加算回路と比較することにより回路性能を考察する。
- 社団法人電子情報通信学会の論文
- 2003-01-22
著者
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