0.18μmプロセスによる差分光再構成型ゲートアレイ(プロセッサ,DSP,画像処理技術及び一般)
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概要
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差分光再構成型ゲートアレイは,FPGA(Field Programmable Gate Array)の一種であるが,回路情報を電気的に書き込むFPGAとは異なり,光学的な書き込みを可能にしたデバイスである.これまでに0.35μ,,mプロセスを用いた差分光再構成型ゲートアレイを開発済みであるが,本稿では,さらに高密度実装した0.18μm高密度差分光再構成型ゲートアレイの設計例について示す.この設計では7.82mm^2のチップに,4個の論理ブロック,5個のスイッチング・マトリックス,16ビットのI/Oビットを実装した.本稿では,再構成回路部,ゲートアレイ部の実装について述べ,受光部に関しては実験結果も示す.
- 社団法人電子情報通信学会の論文
- 2004-10-14
著者
-
小林 史典
九州工業大学情報工学部
-
小林 史典
九州工業大学 情報工学部 (制御システム工学科)
-
渡邊 実
九州工業大学情報工学部情報科学専攻
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小林 史典
九州工業大学情報工学部制御システム工学科
-
小林 史典
九州工業大学
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