機能縮小による耐故障性プロセッサ(耐故障プロセッサとコンピュータシステム)
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概要
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本橋では固定故障が発生する状況において非常に長期間使用することが可能であるCPUについて議論する。故障が発生しても使用し続ける事を前提とした場合にこれに対する従来の解決手法として回路の多重化と回路の代用が挙げられるがそれぞれ問題を抱えている。我々は代用を用いた回路の再構成手法を提案した。提案手法は予備評価において有用であるという結論が得られた。一方、配線遅延による速度への影響、故障部位の再構成手法への影響を無視することはできない。また部分のみに対する再構成手法ではなく、CPU全体に対する再構成システムを評価を必要がある。本橋では部品に対する位置情報を組み込むことによりこれらの問題を解決し、より詳細な再構成手法を評価する。位置情報を組み込んだプログラム実行時間と故障部位による影響をシミュレーションにより評価した。
- 一般社団法人情報処理学会の論文
- 2004-05-14
著者
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