クロックフィールドスルーとチャネル長変調効果を補償したスイッチドボルテージ サンプル/ホールド回路
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概要
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Abstract In this paper, swicthed-voltage (SV) sample/hold (S/H) circuit are presented to compensated for clock feedthouh(CFT) and channel-length modulation effect. The circuit consists of a CMOS SV-delay cell. Thus, the configuration is very simple. The proposed circuit can be operated using simple nonoverlapping two phase clocks. The performance is verified by simulations on PSpice.
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