スイッチドボルテージ低電圧サンプルホールド回路
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概要
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Abstract In this paper, switched-voltage (SV) sample/hold (S/H) circuit is presented for low voltage operation. The circuit consists of a CMOS SV-delay cell. Thus, the configuration is very simple. The proposed circuit can operate using simple nonoverlapping two phase clocks. Performance is verified by simulations on PSpice and using discrete components.
- 2006-08-30
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