FDFMアプローチを用いた3層パーセプトロンのFPGA実装(数値計算と高速化)
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概要
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本論文では,FDFM(Few DSP blocks and Few block RAMs)アプローチを用いたXilinx社Virtex-6シリーズFPGAへの3層パーセプトロンの実装を紹介する.FDFMアプローチではDSPスライスとブロックRAM複数のプロセッサコアを使用し,Xilinx社Virtex-6シリーズFPGA XC6VLX240T-FF1156に150個のプロセッサコアを実装した.実装では,150個のDSPスライス,185個のブロックRAM,9676スライスを用いて入力,中間,出力層がそれぞれ32,32,32個の3層パーセプトロンを150プロセッサコア実装した.その結果として,周波数が242.89MHzで動作し,1秒間に1.65×10^7回パーセプトロンを評価可能であることを確認した.
- 2012-05-22
著者
-
中野 浩嗣
広島大学大学院工学研究科
-
伊藤 靖朗
広島大学大学院工学研究科
-
中野 浩嗣
北陸先端科学技術大学院大学情報科学研究科
-
中野 浩嗣
北陸先端科学技術大学院大学
-
吾郷 祐紀
広島大学大学院工学研究科
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