ロジックエレメントを節約したFPGAラベリング(応用1)
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概要
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本論文では,二値画像の連結成分にユニークなIDを割り当てるラベリングを行うハードウェアアルゴリズムを提案する.FPGA上で実行することを想定した本ハードウェアでは,k-concaveな二値画像に対してラベリングを行う.FPGAに対してラスタスキャン順に入力された二値画像の画素値に対しラベリング処理を行い,その順に処理結果が出力される.本研究のラベリングアルゴリズムの特徴は,効率的にFPGAを利用し,レイテンシが小さいことである.アルテラ社のFPGAを用いて設計したハードウェアを実装し性能評価を行った結果,サイズが2048×2048の20-concaveな二値画像に対して,約2.9msのレイテンシで出力を開始し,約72msでラベリング処理を完了するハードウェアの作成に成功した.そのときのレイテンシが約2.9msである確認した.
- 2009-09-10
著者
-
中野 浩嗣
広島大学大学院工学研究科
-
伊藤 靖朗
広島大学大学院工学研究科
-
中野 浩嗣
北陸先端科学技術大学院大学情報科学研究科
-
中野 浩嗣
北陸先端科学技術大学院大学
-
中野 浩嗣
広島大学大学院工学研究科情報工学専攻
-
中野 浩嗣
広島大学大学院工学研究科複雑システム工学専攻
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