Xilinx Virtex-5 FPGAのDSP48Eブロックを用いたコラッツ予想の検証の効率的実装(システムアーキテクチャ)
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概要
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任意の正の数に対して,偶数のときその数を2で割り,奇数のとき3倍して1を加えるという操作を考える.コラッツ予想は,すべての正の数nに対して上記の操作を繰り返すと最終的に1になるという予想である.本論文では,乗算器と加算器を一つずつ持つXilinx Virtex-5 FPGAのDSP48Eブロックを用いたコラッツ予想の検証の効率的実装を紹介する.我々はVertex-5シリーズのFPGA XC5VSX50T-1を用いて検証プロセッサを実装し,評価をおこなった.その結果として,本手法は,1秒間に3.88×10^8個の64ビットの数が検証可能であることを確認した.
- 2010-05-06
著者
-
中野 浩嗣
広島大学大学院工学研究科
-
伊藤 靖朗
広島大学大学院工学研究科
-
中野 浩嗣
北陸先端科学技術大学院大学情報科学研究科
-
中野 浩嗣
北陸先端科学技術大学院大学
-
中野 浩嗣
広島大学大学院工学研究科情報工学専攻
-
中野 浩嗣
広島大学大学院工学研究科複雑システム工学専攻
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