CUDA実装された共通鍵ブロック暗号のための性能予測モデルの検討(GPUとHPC,FPGA応用及び一般)
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概要
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暗号化によるデータ保護の重要性が日々増している現状において,導入コストを抑えた高速暗号処理を実現する手段の1つとして,GPGPUによる並列処理が注目されている.一方で,現実に利用されているブロック暗号は多数に渡る.そのため,プログラマは暗号のGPGPU実装を行う際,各暗号と実装対象のGPUに対し,反復実験によって最適化せざるを得ない問題に悩まされている.しかしこれまでに,AESを主としてCUDA実装の研究が盛んに行われており,更にAESだけではなく,他の共通鍵ブロック暗号に対してもその実装手法が確立されてきている.これらの共通鍵ブロック暗号のアルゴリズムは,メモリに格納されたテーブルへのアクセスや,整数または論理演算といった単純な要素のみで構成されており,それぞれのアルゴリズムごとに似た構造を持つ.そこで,これらの暗号に共通した処理をいくつかのグループに分類し,それぞれの計算時間を前もって取得することにより,各共通鍵ブロック暗号のアルゴリズムをCUDA実装したときの性能を予測できる可能性がある.本稿では,CUDA実装する共通鍵ブロック暗号の性能予測モデルの実現可能性について検討した結果を報告する.
- 2012-01-18
著者
-
西川 尚紀
防衛大学校情報工学科
-
黒川 恭一
防衛大学校情報工学科
-
黒川 恭一
防衛大学校 情報工学科
-
黒川 恭一
防衛大学校
-
黒川 恭一
防衛大学校理工学研究科情報工学教室
-
岩井 啓輔
防衛大学校
-
岩井 啓輔
防衛大学校 情報工学科
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