再構成可能ASIPsの提案とハイブリッド暗号の実装(VLSIシステム)
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概要
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ASIPsはアプリケーションに応じてその構成を決定していくプロセッサである.そのため,ASICを用いて構成した場合,特化するアプリケーションがダイナミックに変化していく場合などには対応しがたくなる.本論文では, ASICに代わってFPGAを用いることにより再構成可能としたASIPsを提案している.比較的小規模で決まりきったいくつかの処理よりなるアプリケーションを想定し,固定されたマイクロアーキテクチャのもと,特化する処理に応じて命令セットを選択する.更に,主処理部と専用処理部という二つの処理部を設け,どちらもFPGAよりなる再構成可能ASIPとする.この構成により,柔軟性や拡張性を保持しつつ,互いの処理を並列化させられ,素子を再構成するためのシステム停止を極力防ぎつつ,再構成可能素子の低速性を補うことができる.更に,提案した再構成可能ASIPsの実現・検証として,暗号の安全性を確保する一手法であるハイブリッド暗号を実現しつつ,ダイナミックに暗号アルゴリズムを変更するFPGA (XCV300-PQ240) を用いて作製したシステムの実現例を示している.
- 社団法人電子情報通信学会の論文
- 2003-11-01
著者
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