VLIWプロセッサ生成系とVLIWコンパイラ生成系
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概要
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VLIW(Very Long Instruction Word)プロセッサは複数の命令を同時に実行可能なため処理能力が高く, プロセッサの構成も単純であることから, ASIP(Application Specific Integrated Processor)への応用が期待されている. ASIPのハードウェア/ソフトウェア協調設計システムとしてPEAS-IやSatsukiが提案されているが, 設計対象はスカラ型プロセッサに限定されている. 本研究では, VLIWプロセッサに対応したハードウェア/ソフトウェア協調設計のための, VLIWプロセッサのCPUコア生成系とそのプロセッサ用コンパイラの自動生成系を試作した.
- 1997-08-13
著者
-
武内 良典
大阪大学大学院情報科学研究科
-
今井 正治
大阪大学大学院情報科学研究科
-
引地 信之
SRA先端技術研究所
-
大槻 典正
大阪大学大学院基礎工学研究科情報数理系専攻
-
引地 信之
(株)SRA
-
今井 正治
大阪大学大学大学院情報科学研究科
-
武内 良典
大阪大学大学大学院情報科学研究科
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