高速デジタル制御発振回路
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概要
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近年LSIの動作速度向上に伴い、高速クロックの発生が重要になっている。従来このような高速クロックはアナログPLLにより発生されていたが、アナログPLLはデジタルPLLに比べ耐環境性、制御性に劣ることから高周波領域においても動作する高速デジタルPLLの実現が望まれている。そこで今回、高速デジタルPLLの要素回路としてゲート1段の遅延時間で周波数制御可能なデジタル制御発振回路(DCO)を試作しサンプル評価を行ったところ、高時間分解能(約450ps)と広い周波数制御範囲(約530Hz〜16MHz)での動作を確認したので報告する。
- 社団法人電子情報通信学会の論文
- 1994-09-26
著者
-
服部 正
日本電装株式会社基礎研究所
-
服部 正
(株)デンソー 基礎研究所
-
山内 重徳
(株)デンソーシステム開発部
-
秋田 成行
株式会社デンソー
-
秋田 成行
日本電装株式会社基礎研究所
-
大塚 義則
株式会社デンソー
-
山内 重徳
日本電装株式会社基礎研究所
-
渡辺 高元
日本電装株式会社基礎研究所
-
大塚 義則
日本電装株式会社基礎研究所
-
渡辺 高元
(株)デンソー 基礎研究所
-
大塚 義則
デンソー 基礎研
-
服部 正
日本電装株式会社 基礎研究所
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