低消費電力マルチコーデックMPEG-4LSI向けメモリアーキテクチャ (<特集>「VLSI一般」)
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概要
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本稿では、MPEG-4の複数のプロファイルに対応するLSIを低消費電力で実現可能なメモリアーキテクチャについて述べる. 本LSIでは、20MビットのDRAMを6個の小さなDRAMマクロに分割することにより、データ転送量の低減と適応的なDRAMマクロのゲーティンドクロックを実現している. 2個の2MビットのDARMマクロは画像出力用のフレームメモリとして使用され、4個の4MビットのDRAMマクロは画像圧縮伸長処理用のワークメモリとして使用される. 開発したMPEG-4対応LSIはQCIFサイズの画像の圧縮伸長処理を54MHz動作時に90mWで実現可能である.
- 社団法人電子情報通信学会の論文
- 2001-05-18
著者
-
東島 勝義
松下電器産業(株)半導体社開発本部itシステムlsi開発センター
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道山 淳児
松下電器産業株式会社 半導体社 開発本部 プロセッサ開発センター
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井上 昭彦
松下電器産業(株)半導体社開発本部itシステムlsi開発センター
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道山 淳児
松下電器産業研究本部九州研究グループ
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道山 淳児
松下電器産業
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