伝搬遅延を考慮した分割可能バス付きプロセッサアレーの評価
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概要
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本論文では分割可能バス付きプロセッサアレーにおいて,バスおよびバスに挿入したスイッチ素子によって生じる伝搬遅延が半群計算を実行する際の時間計算量に及ぼす影響について考察する.
- 社団法人電子情報通信学会の論文
- 1995-04-25
著者
-
阿部 健一
東北大学工学部
-
前場 隆史
神戸商船大学情報システム工学講座
-
辰巳 昭治
大阪市立大学
-
阿部 健一
東北大学工学部電気系
-
菅谷 光啓
NRIセキュアテクノロジース株式会社
-
菅谷 光啓
(株)野村総合研究所先端システム技術部
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