周波数変換器を用いた2同調形低スプリアスDDS駆動PLLシンセサイザ
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概要
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DDS駆動PLLシンセサイザのスプリアスを抑制するために,周波数変換器を用いた2同調形DDS 駆動PLLシンセサイザを提案し,理論検討および実験結果について述べる.まず,周波数変換の効果によりDDS からPLL出力までの周波数逓倍数を低減でき,シンセサイザ出力でのDDSによるスプリアスレベルを抑制できることを示す.そして, PLLで粗同調しDDSで微同調する2同調形の効果により, DDSの周波数変化幅を狭帯域とでき,高レベルのDDSのスプリアスを避けた周波数設定が容易となることを示す.更に低スプリアスとなるDDSの周波数設定の条件を示す. L帯において周波数間隔0.06 Hzのシンセサイザを試作した. DDSの周波数変化幅が基準クロック周波数に対し0.04%となる条件でスプリアスレベル-60 dBc以下,1 kHz離調時の位相雑音-71 dBc/Hzの性能を得た.
- 社団法人電子情報通信学会の論文
- 1996-07-25
著者
-
伊東 健治
三菱電機株式会社情報技術総合研究所
-
伊東 健治
三菱電機株式会社
-
飯田 明夫
三菱電機株式会社
-
田島 賢一
三菱電機
-
田島 賢一
三菱電機株式会社
-
飯田 明夫
三菱電機
-
西村 修司
三菱電機株式会社
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