動画像マルチデコーダ用動き補償機構の VLSI アーキテクチャ(パーソナルシステム, システムオンシリコン及び一般)
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概要
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携帯機器向け動画像マルチデコーダは, 汎用CPU・DSP上のソフトウェアとして実現可能であるが, 低消費電力化を考慮した場合, 動画像復号化処理に特化した新たな専用アーキテクチャを用いるのが望ましい.本研究は, 専用アーキテクチャによる動画像マルチデコーダの実装に際し, 演算量が多いH.264, MPEG-4, H.263のインター/イントラ予測符号化およびデブロッキングフィルタのアーキテクチャ提案および実装を行う.また, 提案アーキテクチャのバッファサイズや演算器の並列度を変化させ, 回路規模・消費電力のトレードオフを評価する.提案アーキテクチャは, 動作周波数48MHzかつ消費電力23.3mWでCIF画像30fpsに対するリアルタイム処理性能を達成している.
- 社団法人電子情報通信学会の論文
- 2005-03-10
著者
-
尾上 孝雄
大阪大学大学院情報科学研究科
-
白川 功
兵庫県立大学大学院応用情報科学研究科
-
白川 功
兵庫県立大学
-
藤田 玄
大阪大学大学院情報科学研究科
-
藤田 玄
大阪電気通信大学情報通信工学部
-
白川 功
シャープ株式会社情報技術研究所
-
木村 基
大阪大学大学院工学研究科情報システム工学専攻
-
ウィラポーン ワットカナッド
大阪大学大学院
-
木村 基
大阪大学大学院
-
尾上 孝雄
大阪大学大学院工学研究科情報システム工学専攻
-
藤田 玄
大阪大学大学院工学研究科情報システム工学専攻
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