次世代IPバックボーンネットワークを支える高スループット・低消費電力パケット処理アーキテクチャ(IPバックボーンネットワーク,フォトニックネットワーク,高速ネットワークの構成/管理/制御技術,及び一般)
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概要
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現在のIPバックボーンネットワーク用のハイエンドルータは, 20Gbps (gigabit per second)程度のスループットのパケット処理エンジン(packet-processing eneine : PPE)を利用している.2007年頃の次世代IPバックボーンルータのPPEは,100Gbps程度のスループットを必要とするが,パケットを複数の内蔵プロセッサで並列処理する従来型PPE方式による実現は問題が大きい.これは,内蔵プロセッサ数を増加させるためにLSIのダイサイズ及び消費電力が許容範囲を超える恐れがあるためである.本稿では,同一ヘッダ情報を持つパケットが短時間に多数出現するネットワークトラフイックの性質を利用し,キャッシュと小規模の付加論理で100Gbpsスループットを実現する学習型PPE方式の詳細を示した.0.13um CMOSプロセス,1.2V電源,333MHzの動作周波数でダイサイズと最大消費電力の見積りを行った結果,学習型PPEは,従来型PPEの36.6%のダイサイズ,32.6%の最大消費電力で1OOGbpsのスループットを実現でき,次世代IPバックボーンルータのPPEとして有望である見通しを得た.
- 社団法人電子情報通信学会の論文
- 2004-10-08
著者
-
西 宏章
日立製作所中央研究所 ネットワークプラットフォーム研究部
-
奥野 通貴
日立製作所中央研究所
-
奥野 道貴
(株)日立製作所中央研究所
-
奥野 通貴
(株)日立製作所中央研究所
-
西宏 章
慶應義塾大学理工学部
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