構造可変型プロセッサネットワークへの信号処理プログラムスケジューリングの検討
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概要
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集積規模の拡大に伴い、数十程度のマルチマイクロプロセッサシステムをオンチップ実装できるようになりつつある。しかしながら、実際の信号処理システムの搭載には、専門家がマニュアルでスケジューリングしている状況であり、実用化の最大の足枷になっている。我々は、32bマイクロプロセッサを単位とする、可変プロセッサネットワークによる信号処理システムの自動生成を目標にしているが、本論文では、C言語で書かれた信号処理プログラムから、並列性の自動抽出を行った。特にループ処理に着目し、ループ内及びループ間での、並列性の自動抽出法を提案し、実際に、FFTプログラムをマイクロプロセッサネットワークにスケジューリングし、その有効性を確認した。
- 社団法人電子情報通信学会の論文
- 1998-03-05
著者
-
山内 寛紀
立命館大学理工学研究科
-
西門 秀人
立命館大学
-
山内 寛紀
立命館大学大学院理工学研究科
-
山内 寛紀
立命館大 大学院総合理工学研究科
-
石井 宏明
立命館大学理工学部電気電子工学科
-
仁志 彰宏
立命館大学理工学部電気電子工学科
-
山内 寛紀
立命館大学 総合理工学研究機構 VLSIセンター
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