線形順序回路に否定素子を付加したときの動作特性解析法
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概要
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VLSI回路の組込み自己検査(BIST)では,テストパタン生成回路として線形順序回路が用いられるが,それに否定素子を挿入してテストパタン系列をテストに便利なように修正することもある.本文では,線形順序回路に否定素子を付加した動作解析法を提案し,例を示している.まず,否定演算を次状態関数の定数項とすることによって,回路の循環的な動作を規定する基本的な式を導いている,また,遷移行列を否定素子の効果を現す状態変数を付加することによって拡張し,その遷移行列の特性多項式と最小多項式よって,回路の動作がある程度予測できることを示している.
- 社団法人電子情報通信学会の論文
- 2001-04-06
著者
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