一線式非同期全加算器回路の一方式
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概要
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非同期SFQ論理回路方式としての, 一線式全加算器回路を提案する.ここに提案する回路は, 論理"1"をSFQの正方向信号, 論理"0"を負方向信号に対応させたシステムに基づいて設計を行っており, この正パルス, 負パルスによる2進符号表現を用いれば, 送受認識信号を必要としない高性能非同期論理回路を実現できる.本稿では, 非同期におけるSFQ全加算器回路を提案し, 動作原理の説明を行い, シミュレーションにより動作の確認と性能を評価している.
- 社団法人電子情報通信学会の論文
- 2001-01-17
著者
-
藤坂 尚登
広島市立大学
-
坂本 政祐
広島市立大学情報科学部情報機械システム工学科
-
森末 道忠
広島市立大学情報科学部情報機械システム工学科
-
森末 道忠
広島市立大学情報科学部
-
坂本 政祐
広島市立大学
-
中村 幸保
広島市立大学
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