実時間数列生成アルゴリズムの1ビット通信セルラ・オートマトン上での実装について
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概要
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Fibonacci, {2^n|n=1, 2, 3…}, {n^2|n=1, 2, 3…}などいくつかのnon-regularな数列が, セルラ・オートマトン上で実時間で生成可能なことが知られている.これらの結果はセル間通信量がO(1)ビットのセルラ・オートマトン上で示されたものであるが, 本稿では, セル間の通信量を1ビットに制限したモデル(CA_1-bit)上に実装し, 上記に示した数列がそれぞれ内部状態数9, 4, 3のCA_1-bitで実現可能なことを示す.
- 一般社団法人情報処理学会の論文
- 2000-11-21
著者
-
梅尾 博司
大阪電気通信大学大学院工学研究科情報工学専攻
-
上川 直紀
大阪電気通信大学
-
上川 直紀
大阪電気通信大学大学院工学研究科情報工学専攻
-
梅尾 博司
大阪電気通信大学総合情報学部情報工学科
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梅尾 博司
Dept. Of Applied Electronic Engineering Faculty Of Engineering Osaka Electro-communication Univ.
-
梅尾 博司
大阪電気通信大学
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