FPGAを用いた再構成可能な並列信号処理装置

概要

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近年の集積回路技術の進歩により, 従来は困難であった方式の実現性が高まっている。特にFPGA (Field Programmable Gate Array)は, 専用のハードウェア回路をソフト的に書き換えることが可能であり, かつ, 近年その動作速度, 集積度も向上してきているため, その用途が拡大してきている。例えば, 高速性が要求されるため, 専用のハードウェアでしか組めなかった回路の融通性を高めることが可能となり, 再構成可能な処理装置の構成を導くことができる。また, 信号処理の分野においては, 古くからその高速処理の研究がなされているが, 対象とする分野によっては, 高速性以外に回路規模の縮小化が強く望まれる。例えば, 航空機に搭載するレーダ信号処理装置などは, 高速処理もさることながら, 搭載できるスペースが限られるため, 回路規模と処理速度の兼合いが大きな課題となっている。また, 機能向上の面から, 特徴の異なる複数のセンサを搭載しで, 対象物に対応したセンサを効率的に使用することも検討されており, これらに対応した柔軟な構成も課題の一つである。本論文では, 上記の課題に対応可能なFPGAを使用した並列信号処理装置を提案する。
一般社団法人情報処理学会の論文
1997-09-24