C-12-5 25Gbit/s動作に向けたプリエンファシス機能付き65nm-CMOS出力バッファ回路の検討(アナログ回路,C-12.集積回路,一般セッション)
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概要
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- 2014-03-04
著者
-
桂井 宏明
日本電信電話株式会社NTTマイクロシステムインテグレーション研究所
-
岸根 桂路
滋賀県立大学
-
稲葉 博美
滋賀県立大学
-
岸根 桂路
滋賀県立大学工学部電子システム工学科
-
野河 正史
日本電信電話(株)マイクロシステムインテグレーション研究所
-
井上 洋
滋賀県立大学大学院工学研究科電子システム工学専攻
-
田中 友規
滋賀県立大学工学部電子システム工学科
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