誤り訂正符号を用いた軽量な高速シリアル通信機構の実装と評価(2010年並列/分散/協調処理に関する『金沢』サマー・ワークショップSWoPP2010)
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概要
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FPGA間の通信向けに,十分な訂正能力を持ち,軽量で高速な符号化方式が求められている.以上のような要求を満たすものとして澤らが提案した符号化方式に着目する.本稿では,澤らの符号化方式をFPGAに実装し,評価を行った.その結果,復号器は260程度の4入力LUTで実装でき,3サイクルで復号可能であることが分かった.また,SEC-DED (single error correcting - double error detectiong)符号と比較して,低いエラーレートで通信が可能であった.
- 2010-07-28
著者
-
高前田 伸也
東京工業大学工学部情報工学科
-
吉瀬 謙二
東京工業大学大学院情報理工学研究科
-
吉瀬 謙二
東京工業大学
-
金子 晴彦
東京工業大学大学院情報理工学研究科
-
坂口 嘉一
東京工業大学大学院情報理工学研究科
-
アスリ モッハマド
東京工業大学
-
高前田 伸也
東京工業大学大学院情報理工学研究科
-
金子 晴彦
東京工業大学
-
坂口 嘉一
東京工業大学 工学部情報工学科
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