小容量FPGAによるスケーラブルなシステム評価環境の構築手法(応用2)
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概要
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メニーコアプロセッサの動作を現実的な時間でシミュレーションするために,我々はハードウェアによるシミュレーション環境ScalableCoreを提案している.これは,シミュレーションノード(ScalableCore unit)を,4方向に拡張可能な共通の接続インターフェース(ScalableCore board)を用いて接続することで,高い拡張性を実現する.小容量のFPGAを複数用いたScalableCoreの実装方法を検討する.この実装方法は,メニーコアプロセッサ内の各コアを各FPGAに対応づけることで,ハードウェアによるシミュレーションの実装で問題となる複雑さを軽減させることができる.また,それぞれ独立したFPGAパッケージであることから,各ScalbleCore unitが必要とするメモリに接続するためのポートを十分に確保することができる.初期評価として,ScalableCore UnitとScalableCore Boardを試作し,シミュレーション速度を評価したところ,ソフトウェアシミュレータ比で約7倍程度のスピードアップにとどまり,高速化への課題があることを確認した.
- 2009-09-10
著者
-
高前田 伸也
東京工業大学工学部情報工学科
-
渡邉 伸平
東京工業大学大学院情報理工学研究科
-
吉瀬 謙二
東京工業大学大学院情報理工学研究科
-
吉瀬 謙二
東京工業大学
-
三好 健文
東京工業大学大学院情報理工学研究科
-
姜 軒
東京工業大学大学院情報理工学研究科
-
三好 健文
東京大学大学院情報理工学系研究科創造情報学専攻
-
三好 健文
東京工業大学大学院情報理工学研究科|独立行政法人科学技術振興機構
-
高前田 伸也
東京工業大学大学院情報理工学研究科
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