線形計画法を用いた電源ノイズ解析高速化手法の検討(遅延・電源ノイズ解析,デザインガイア2008-VLSI設計の新しい大地-)
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概要
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近年線形計画法を使用して電源ネットに関する電源ノイズ解析を行う手法が提案されている.提案されている既存手法を用いて,マイクロプロセッサの電源ノイズ解析を行おうとした場合,次の2つの問題点があった.1)実行マシンcycle毎に制約式をたてなければならない,2)ノード毎に最適化しなければならない.そこで結果として膨大な計算量が必要となってしまう.我々は,一回のマシンcycleだけの解析で,しかも目的関数を工夫することで,一度の最適化で所望の解析が可能な手法を提案する.縦・横20分割された電源配線RCモデルを用いて提案手法を評価した結果,既存手法に対し,解析誤差は最大13%,平均10%,解析CPU時間は1.1×10^5分の1となった.またSPICE^[○!R]を用いた解析と比較した結果,解析誤差は最大20%,平均16%,および解析CPU時間は83分の1とすることができた.
- 一般社団法人情報処理学会の論文
- 2008-11-10
著者
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