ODRGA-VLSIのゲートアレイ動作時における高速再構成(リコンフィギャラブルアーキテクチャ2)
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概要
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近年,高速な再構成を目的として,ホログラムメモリを用いた光再構成型ゲートアレイが開発されている.しかし,初期の光再構成型ゲートアレイでは受光部とゲートアレイ間にシリアル転送が用いられており,再構成時間が16μsに制限され,かつ,再構成処理の間,ゲートアレイが使用できない問題があった.そこで,我々は,シリアル転送を用いない,ナノ秒での再構成が可能で,かつ再構成処理中もゲートアレイの使用が可能な差分光再構成型ゲートアレイを開発している.本稿では,液晶ホログラムを用いた差分光再構成型ゲートアレイの62.5nsでの連続再構成試験の結果を示す.
- 社団法人電子情報通信学会の論文
- 2007-09-13
著者
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