ダイナミック光再構成アーキテクチュアの再構成時間と保持時間の測定(リコンフィギャラブルアーキテクチャ2)
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概要
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近年,高速再構成可能な様々なデバイスが開発されているが,我々は光を使い2次元的に高速再構成可能な光再構成型ゲートアレイについて研究を進めている.これまでの光再構成ゲートアレイでは,回路情報を保持する為に静的なメモリをVLSI内部に実装していたが,この静的なメモリが光再構成型ゲートアレイVLSIの高集積化を阻んでいた.そこで,我々は,コンテキスト情報を読み取るフォトダイオードをメモリとしても使用し,再構成に使用する静的なメモリを全廃したダイナミック光再構成アーキテクチュアを提案している.本稿では,このアーキテクチュアがホログラムメモリと組み合わされた状態でも有効な事を,実装回路の再構成時間と保持時間を明らかにすることで示す.
- 社団法人電子情報通信学会の論文
- 2007-09-13
著者
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