パイプライン型ADCの高速デジタルバックグランドキャリブレーション(再構成可能デバイス/キャリブレーション,システムオンシリコン設計技術並びにこれを活用したVLSI)
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概要
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高サンプルレートかつ高分解能のADCは、次世代無線システムのキーデバイスとなる。UC Berkeleyグループが提案したデジタルバックグランドキャリブレーション方式を適用すれば、このような高性能ADCの消費電力を、従来のアプローチと比較して著しく低減できる。しかし、同キャリブレーション方式は、実際の無線アプリケーションに適用するには収束時間が長過ぎる問題がある。そこで今回、Berkeley方式をベースとして、キャリブレーションの収束時間を短縮する新しい方式を提案し、MATLAB/SIMULINKシミュレーションにより、その有効性を示した。
- 社団法人電子情報通信学会の論文
- 2007-03-01
著者
-
大島 俊
株式会社日立製作所 中央研究所
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大島 俊
日立製作所中央研究所
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Tsang Cheonguyen
バークレーワイアレスリサーチセンタ(カリフォルニア大学バークレー)
-
Nikolic Borivoje
バークレーワイアレスリサーチセンタ(カリフォルニア大学バークレー)
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