17-4 テトロード構造を用いた低消費電力CCD出力回路

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概要

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• A new structure for an output circuit of HDTV CCD imager has been developed. This structure has overlapped two poly-silicon electrodes. The highest applicable drain voltage for the 0.7 μm effective channel length structure reaches to 12 V with no degradation of mutual conductance. The usage of a low concentration n layer under the drain-side electrode ensures longer than 10 years lifetime. The calculated power of an output circuit using the structure is 29 mW with 110 MHz cut-off frequency and 0.57 voltage gain.

• 社団法人映像情報メディア学会の論文
• 1993-07-27

著者

• 田中 治彦

  株式会社日立製作所中央研究所

• 尾崎 俊文

  株式会社日立製作所中央研究所

• 尾崎 俊文

  (株)日立製作所中央研究所

• 尾崎 俊文

  日立製作所中央研究所

• 田中 治彦

  (株)日立製作所中央研究所

• 佐野 聡明

  日立デバイス

• 佐野 聡明

  株式会社日立デバイスエンジニアリング武蔵野事業所

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