16-8 第2世代MUSEデコーダLSIの開発 : 映像
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概要
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We have developed 5 chip digital video processor LSIs for second generation 6 chip MUSE (HDTV) decoder. These reduce memory requirement for MUSE decoder to 12Mbit (60% of former level) and power consumption to 10 watts. This chip set will enable development of a smaller, lower-power MUSE decoder.
- 社団法人映像情報メディア学会の論文
- 1992-07-28
著者
-
水越 正孝
富士通株式会社
-
栗田 昌徳
株式会社富士通研究所
-
小檜山 清之
富士通株式会社
-
田原 法明
株式会社富士通研究所
-
吉田 昌弘
(株)富士通研究所システムlsi開発研究所
-
乙部 幸男
富士通株式会社
-
吉田 昌弘
富士通株式会社
-
瀬野尾 晴美
富士通株式会社
-
高橋 秀長
富士通株式会社
-
栗田 昌徳
富士通株式会社
-
冨田 昌義
富士通株式会社
-
田原 法明
富士通株式会社
-
杉原 広威
富士通株式会社
-
瀬野尾 晴美
株式会社富士通研究所
-
乙部 幸男
(株)富士通研究所システムlsi開発研究所
-
杉原 広威
富士通
-
高橋 秀長
富士通(株)電子デバイス事業本部
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