ディジタルPWMの分解能改善方法(回路、制御技術関連、一般)
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概要
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近年, スイッチング電源の分野で制御部のインテリジェンス化・ハードウェア共通化等の要求のために, 制御部をディジタル化する動きが進んでいる.様々なコンバータトポロジーの制御部のハードウェアを共通化するためには, 任意のタイミングでパルスが生成できるPWMジェネレータが必要であり, これはPWMジェネレータ部をディジタル化すれば容易に実現可能である.しかしながら, ディジタル回路によるPWMジェネレータは, キャリア波が階段波となり, クロック周期で刻み幅が決まるため, PWM出力パルスの分解能はクロック周期に依存する.この依存性は, スイッチング周波数が高くなるほど悪影響を及ぼすため, 制御部のディジタル化における重要な問題となっている.本論文では, パルスを合成する技術を用いて, ディジタルPWMの分解能を格段に改善できる方法を提案しており, またDSPを用いて試作機を製作し, 実験による検証をしている.
- 2005-11-04
著者
-
樋口 幸治
電気通信大学電子工学科
-
中野 和司
電気通信大学電子工学科
-
富岡 聡
デンセイ・ラムダ株式会社
-
中野 和司
電気通信大学
-
竹上 栄治
デンセイ・ラムダ株式会社
-
竹上 栄治
デンセイ・ラムダ(株) 先行開発
-
樋口 幸治
電気通信大学大学院
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