再構成可能な並列プロセッサのアーキテクチャの一設計
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概要
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計算機の高速化のために、ソフトウェアに応じてハードウェアを再構成できるニューラルネットワーク専用プロセッサの研究を行ってきた。本稿では、ニューラルネットワーク以外の一般の演算を実行するために、このアーキテクチャの拡張を行う。特にC言語を処理する機能を付加した並列処理プロセッサである"Connection Code Computer(CCC)"のアーキテクチャを提案する。
- 社団法人電子情報通信学会の論文
- 1997-08-13
著者
-
森下 賢幸
岡山県立大学 情報工学部
-
畑野 文博
岡山県立大学情報工学部
-
寺本 巖
岡山県立大学 大学院 情報系工学研究科
-
寺本 巌
岡山県立大学情報工学部
-
寺本 巌
岡山県立大学
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森下 賢幸
岡山県立大学情報工学部
-
寺本 巖
岡山県立大学情報工学部
-
寺本 厳
岡山県立大学 大学院 情報系工学研究科
-
畑野 文博
岡山県立大学 大学院 情報系工学研究科
-
森下 賢幸
岡山県大 情報工
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森下 賢幸
岡山県立大学
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