任意分数設定型フラクショナルN・PLLのスプリアス低減技術
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概要
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無線装置の局部発振器に広く用いられているPLL周波数シンセサイザは、周波数ステップが小さくなると位相雑音が劣化し、周波数切替え時間が長くなるという欠点を持つ。これを解決する技術の一つにフラクショナルN・PLLがあるが、分周比の周期的な切替えに伴い、スプリアスを生じる。このスプリアスを抑圧するためにループフィルタの帯域を狭くすると、位相雑音や周波数切替え特性が劣化するため、DACを用いた位相補間回路や分周比の変化を頻繁に行なう方式が用いられる。我々はこれまでに、周波数ステップと基準周波数との比を可変にでき、高い柔軟性を有する任意分数設定型フラクショナルN・PLLの提案を行なった。今回、このPLLに簡単な付加回路を設けてスプリアスを低減するシンセサイザ構成を考案し、実験により良好な特性を得たので報告する。
- 社団法人電子情報通信学会の論文
- 1996-09-18
著者
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