ハードウェア実現のための進化論的ディジタルフィルタの並列構成の提案とそのFPGA上での実現
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概要
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本稿では, 進化論的ディジタルフィルタ(evolutionary digital filter: EDF)のハードウェア実現を目的として, 内部モジュールの並列構成を提案し, その主要モジュールをFPGA上に実装する. 提案法では, 2乗平均誤差の収束特性に劣化が生じない範囲で, 生殖アルゴリズムをハードウェアに適したものに変更する. さらに, ハードウェアをEDFにおけるフィルタリングと係数更新の2モジュールで構成する. 本稿でターゲットデバイスとした112万ゲートのFPGA上に, 主要モジュールであるフィルタリング・適応度計算(FFC)モジュールと生殖・淘汰(RS)モジュール内の無性生殖(ARS)モジュールを16bitで実装した. その結果, FFCは14.4MHzの速度で内部モジュールを4個実装可能, ARSは48.4MHzの速度で無性生殖を行う親と同数である32個実装可能であった.
- 社団法人電子情報通信学会の論文
- 2001-06-22
著者
-
阿部 正英
東北大学大学院工学研究科電子工学専攻
-
川又 政征
東北大学大学院工学研究科電子工学専攻
-
福崎 真理
東北大学大学院工学研究科電子工学
-
対馬 尚之
東北大学大学院工学研究科電子工学
-
対馬 尚之
東北大学大学院工学研究科
-
阿部 正英
東北大学大学院工学研究科
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