FG-MOSFETを用いた低電圧電流モード積分器の一構成
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概要
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本稿では, 多入力素子であるFloating-Gate MOSFET(FG-MOSFET)を用いた低電圧電流モード完全差動積分回路の一構成を提案している.提案回路は, FG-MOSFET2個からなるクロスカップル回路ならびに同相モードアンプから構成されている.FG-MOSFETのSPICEサブサーキットを用いて, SPICEシミュレーションを行い, 提案回路が電源電圧1.5Vで動作可能で、かつ高CMRRの回路であることを確認した.
- 社団法人電子情報通信学会の論文
- 1998-06-25
著者
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