FPGAによる1.5Mbit/s VLMS-MLSE等化器の構成と特性
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概要
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移動通信におけるメガビットオーダーの高速信号伝送を実現する場合に必要不可欠なものとなる遅延歪み補償技術として, VLMS-MLSE等化器を取り上げ, その回路規模の低減法を提案する. さらに, 等化器をFPGAを用いて室内試作し, QPSKを適用した1.5Mbit/s室内信号伝送系においてその特性を評価した. 試作した等化器は約40kgate相当で構成され, 少なくとも1.5Mbit/sのスル-プットを確保できる. また, 遅延分散650nsecの2波独立のマルチパスレイリーフェージング伝送路においてフロア誤りを10^<-5>以下に抑圧し, 8シンボルで初期収束が完了する優れた同期特性も実験により検証した.
- 社団法人電子情報通信学会の論文
- 1996-10-17
著者
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