非同期式パイプライン制御回路の論理合成法(論理合成+高位合成)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
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概要
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本論文では,依存性グラフと依存関係の組で与えた仕様から,非同期式プロセッサのパイプライン制御回路を合成する手法を提案している.この手法により,依存性グラフと依存関係にしたがって各ノードに対応する制御モジュールを適宜ハンドシェーク接続するだけで制御回路を実現させることができる.特に,制御の流れを稼働相と休止相に分け,それらを並列に動作させることにより,パイプラインの高速化を図っている.また,この手法により,従来の手法よりもハードウェア量が小さくなると考えられる.
- 社団法人電子情報通信学会の論文
- 2004-11-25
著者
-
岡野 浩三
岡山大学大学院自然科学研究科
-
大西 陽三
岡山大学大学院自然科学研究科
-
岡本 卓爾
岡山理科大学工学部電子工学科
-
籠谷 裕人
岡山大学大学院自然科学研究科
-
杉山 裕二
岡山大学工学部通信ネットワーク工学科
-
籠谷 裕人
岡山大学工学部通信ネットワーク工学科
-
岡本 卓爾
岡山大 工
-
岡本 卓爾
岡山大学大学院自然科学研究科
-
岡本 卓爾
岡山理科大学工学部
-
寵谷 裕人
岡山大学工学部情報工学科
-
杉山 裕二
岡山大学工学部
-
岡本 卓爾
岡山大学
-
岡本 卓爾
岡山大 大学院自然科学研究科
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