FPGAを用いたオープンプラットフォーム対応IP検証環境(FPGAとその応用及び一般)
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概要
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IPの使用を検討する段階でIPの機能・品質・性能を実機で検証できるIP検証環境について報告する.IP検証環境は,TI-Engine/μT-Engineとその拡張バスに接続するFPGAボードで構成しでいる.試作したIP検証環境は検証対象のIPをFGPAボードに実装し,μT-Engine 上でIP検証用のミドルウエアと評価プログラムを実行することで1)オープンな検証環境,2)ハードウエアとソフトウエアを併せて検証できる検証環境,3)IP流通の促進を実現する.ここではIP検証環境の構成とFPGAボードにIPを実装し,評価プログラムを用いてIPを検証することで検証環境としての有効性を示すとともに,オープンプラットフォーム対応として2種類のμT-Engine を用いてIP検証環境を構築する事例について説明する.
- 社団法人電子情報通信学会の論文
- 2004-01-16
著者
-
稲坂 朋義
三菱電機株式会社情報技術総合研究所
-
中込 宏
三菱電機(株)情報技術総合研究所
-
中込 宏
三菱電機株式会社
-
今井 正紀
(株)半導体理工学研究センター
-
稲坂 朋義
三菱電機(株)情報技術総合研究所リアルタイムプラットフォーム技術部
-
三部 健
三菱電機株式会社情報技術総合研究所
-
今井 正紀
株式会社半導体理工学研究センター
-
三部 健
三菱電機株式会社
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