スキャン論理設計手法に関する一考察
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概要
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電子計算機のスキャン論理を設計する場合、スキャン論理で使用するゲート数をより少なく設計する必要がある。しかし従来手法では、装置に余分なゲートを作り込む可能性があった。この問題に対処するためスキャン論理の信号に着目し、不要ゲートを削減するスキャン論理設計手法を考案した。本文ではその内容について報告する。
- 一般社団法人情報処理学会の論文
- 1990-03-14
著者
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鈴木 和夫
(株)日立エンジニアリング・アンド・サービス
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村上 智一
(株)日立製作所中央研究所組込みシステム基盤研究所組込みソフトウェア研究部
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鈴木 和夫
(株)日立コンピュータエレクトロニクス
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兼田 太
(株)日立コンピュータエレクトロニクス
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北澤 保則
(株)日立コンピュータエレクトロニクス
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森 照夫
(株)日立製作所
-
東 暁夫
(株)日立製作所
-
村上 智一
(株)日立コンピュータエレクトロニクス
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