パルス数カウント方式による高速引込み・広同期範囲全ディジタルFLL
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概要
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The frequency locked loop (FLL) can realize fast pull-in time and a wide lock range compared to a phase locked loop (PLL). However, since FLL has more problems than a PLL, it is not frequently used. In this paper, a simple all digital FLL (ADFLL) is proposed, which has a fast pull-in time and wide rock range. This circuit can detect frequency error within two cycle of output signal and one cycle of input signal later; therefore it can be realize a fast pull-in time. Since lock range is controlled by the division ratio of the programmable divider, this circuit has a wide lock range. This circuit will be integrated into silicon and operate at high-speed.
- 東海大学の論文
著者
-
佐々木 博文
東海大学産業工学部電子知能システム工学科
-
藤本 邦昭
東海大学産業工学部電子知能システム工学科
-
矢原 充敏
東海大学福岡短期大学情報処理学科
-
藤本 邦昭
九州東海大学工学部
-
佐々木 博文
九州東海大学工学部
-
高橋 宣明
東海大学工学部電子工学科
-
高橋 宣明
東海大学電子情報学部
-
矢原 充敏
東海大学福岡短期大学
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