熊木 武志 | 立命館大学 理工学部
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概要
関連著者
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熊木 武志
立命館大学 理工学部
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藤野 毅
立命館大学
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藤野 毅
立命館大学理工学部
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熊木 武志
立命館大学理工学研究科
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熊木 武志
立命館大学大学院理工学研究科
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藤野 毅
立命館大 理工
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藤野 毅
立命館大学vlsiセンター
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本多 隼也
立命館大学大学院理工学研究科
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望月 陽平
立命館大学 理工学部
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小倉 武
立命館大学大学院理工学研究科
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望月 陽平
立命館大学理工学部
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望月 陽平
立命館大学大学院理工学研究科
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村上 佑馬
立命館大学理工学部
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村上 佑馬
立命館大学理工学研究科
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本多 隼也
立命館大学理工学部
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吉田 直之
立命館大学大学院理工学研究科
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松本 直樹
立命館大学大学院理工学研究科
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竹田 知弘
立命館大学大学院理工学研究科
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木股 雅章
立命館大学
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小倉 武
NTT生活環境研究所
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吉田 直之
立命館大学院理工学研究科
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熊木 武志
広島大学ナノデバイス・バイオ融合科学研究所
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松本 直樹
立命館大学理工学研究科
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望月 陽平
立命館大学理工学研究科
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塚田 靖史
立命館大学理工学部
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中川 和歩
立命館大学理工学部
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竹田 知弘
立命館大学理工学研究科
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吉川 雅弥
名城大学理工学研究科
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小倉 武
立命館大学理工学部電子情報デザイン学科
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堀 遼平
立命館大学院理工学研究科
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藤野 穀
立命館大学理工学部
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堀 遼平
立命館大学 理工学部
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黒川 悠一朗
立命館大学院理工学研究科
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板屋 修平
立命館大学理工学部
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大澤 昌弘
立命館大学大学院理工学研究科
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黒川 悠一朗
立命館大学大学院理工学研究科
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竹田 知弘
立命館大学理工学部
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板屋 修平
立命館大学大学院理工学研究科
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堀 遼平
立命館大学大学院 理工学研究科
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木股 雅章
三菱電機株式会社先端技術総合研究所
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木股 雅章
三菱電機(株)先端技術総合研究所ニューロ応用技術部
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吉川 雅弥
名城大学理工学部
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松本 直樹
立命館大学院理工学研究科
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小倉 武
立命館大学理工学部
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堀 遼平
立命館大学大学院理工学研究科
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吉川 雅弥
名城大学理工学研究科情報工学専攻
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柳原 裕樹
立命館大学理工学研究科
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吉川 雅弥
名城大学理工学部情報工学科
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吉川 弘起
立命館大学理工学研究科
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熊木 武志
立命館大学理工学部
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吉田 直之
立命館大学理工学研究科
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藤野 毅
立命館大学 理工学部
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中尾 慧
立命館大学理工学部
-
堀 遼平
立命館大学理工学部
-
柳原 裕樹
立命館大学理工学部
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佐藤 隆亮
名城大学大学院理工学研究科情報工学専攻
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吉田 将之
名城大学大学院理工学研究科情報工学専攻
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夕川 諒平
立命館大学理工学部
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塚平 峻矢
名城大学理工学研究科
-
松島 大祐
名城大学理工学研究科
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木股 雅章
立命館大学理工学部機械工学科
著作論文
- A-1-3 超並列SIMD型プロセッサMX-1のためのガロア体演算によるAES用SubBytes変換の高速化(A-1.回路とシステム,一般セッション)
- A-1-2 超並列SIMD型演算プロセッサMX-1へのMersenne Twisterの実装(2)(A-1.回路とシステム,一般セッション)
- A-1-1 超並列SIMD型演算プロセッサMX-1へのMersenne Twisterの実装(1)(A-1.回路とシステム,一般セッション)
- 超並列処理を用いた疑似乱数生成アルゴリズムMersenneTwisterの実装及び評価(並列処理技術,組込み技術とネットワークに関するワークショップETNET2011)
- 超並列処理を用いた疑似乱数生成アルゴリズムMersenneTwisterの実装及び評価(並列処理技術,組込み技術とネットワークに関するワークショップETNET2011)
- マックスプラス代数系に基づくモルフォロジカル・ウェーブレット変換を用いた電子透かしの実装及び評価(五感メディアの品質,コミュニケーションデザイン,画像符号化,食メディア,一般)
- マックスプラス代数系に基づくモルフォロジカル・ウェーブレット変換を用いた電子透かしの実装及び評価(五感メディアの品質,コミュニケーションデザイン,画像符号化,食メディア,一般)
- 超小型組込みボードを用いた暗号処理の並列化に関する研究(並列処理技術,組込み技術とネットワークに関するワークショップETNET2011)
- 超小型組込みボードを用いた暗号処理の並列化に関する研究(並列処理技術,組込み技術とネットワークに関するワークショップETNET2011)
- SIMD型組込みプロセッサによる擬似乱数生成アルゴリズムの並列処理実装とその評価(計算機システム,学生論文)
- 暗号処理用LSIに組み込まれたハードウェアトロイに関する研究(設計手法及び一般,デザインガイア2011-VLSI設計の新しい大地-)
- センサノード低消費電力化のためのノーマリーオフ動作検証環境の構築と評価
- センサノード低消費電力化のためのノーマリーオフ動作検証環境の構築と評価
- 組み込み機器における効果的な情報ハイディング手法の検討(画質・音質評価,知覚・認知メトリクス,人間視聴覚システム,一般)
- 超高速並列演算コアを用いたモルフォロジカルパターンスペクトラムの実装と評価
- 超高速並列演算コアを用いたモルフォロジカルパターンスペクトラムの実装と評価
- 暗号処理用LSIに組み込まれたハードウェアトロイに関する研究
- A-7-1 超小型組込みボードを用いた階層型フィルタリング手法の実装と評価(A-7.情報セキュリティ,一般セッション)
- ストリーム暗号CryptMTのデータ並列処理による高速化手法及びSIMD型組込みプロセッサによる実装と評価(計算機システム,学生論文)
- A-7-9 ストリーム暗号CryptMTのデータ並列処理による高速化について(A-7.情報セキュリティ,一般セッション)
- A-7-4 モルフォロジカルパターンスペクトラムを用いた検出技術によるプライバシー保護手法の検討(A-7.情報セキュリティ,一般セッション)
- C-12-32 連想メモリを用いたハードウェアトロイ監視回路についての検討(LSIアーキテクチャ,C-12. 集積回路,一般セッション)
- RC-002 マトリクスアーキテクチャ型超並列演算プロセッサを用いたMersenne Twisterの並列処理実装とその評価(計算機アーキテクチャと並列処理,C分野:ハードウェア・アーキテクチャ)
- N-035 プライバシー保護のための閲覧者権限に応じた画像フィルタリング手法の提案(電子化知的財産・社会基盤,N分野:教育・人文科学)
- C-014 対策回路に対するハードウェアトロイの検討(LSI システムと設計技術,C分野:ハードウェア・アーキテクチャ)
- トリプルDES回路に組み込まれたハードウェアトロイの試作とその検知手法の検討(応用システム,デザインガイア2012-VLSI設計の新しい大地-)
- N-036 プライバシー保護のための閲覧者に応じた画像フィルタリング手法の実装と評価(電子化知的財産・社会基盤,N分野:教育・人文科学)
- センサノード低消費電力化のためのノーマリーオフ動作検証環境の構築と評価(省電力化機構,組込み技術とネットワークに関するワークショップETNET2013)
- 超高速並列演算コアを用いたモルフォロジカルパターンスペクトラムの実装と評価(管理機構,組込み技術とネットワークに関するワークショップETNET2013)
- 超高速並列演算コアを用いたモルフォロジカルパターンスペクトラムの実装と評価(管理機構,組込み技術とネットワークに関するワークショップETNET2013)
- センサノード低消費電力化のためのノーマリーオフ動作検証環境の構築と評価(省電力化機構,組込み技術とネットワークに関するワークショップETNET2013)
- フォールト解析対策回路を対象としたハードウェアトロイの実装と評価(ディペンダブル(2),システムオンシリコンを支える設計技術)
- モルフォロジカルパターンスペクトラムを用いた画像改ざん検知手法の提案(画像処理・符号化及び一般)
- O-025 階層型フィルタリング手法を用いた監視カメラデモシステム開発とその評価(O分野:情報システム,一般論文)
- M-025 間歇動作による低消費電力イメージセンサノードの開発と検証(M分野:ユビキタス・モバイルコンピューティング,一般論文)
- トリプルDES回路に組み込まれたハードウェアトロイの試作とその検知手法の検討