更田 裕司 | 大阪大学情報科学研究科情報システム工学専攻

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概要

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関連著者

• 更田 裕司

  大阪大学情報科学研究科情報システム工学専攻

• 橋本 昌宜

  大阪大学大学院情報科学研究科

• Onoye T

  Kyoto Univ. Kyoto‐shi Jpn

• 橋本 昌宣

  大阪大学情報科学研究科情報システム工学専攻

• 密山 幸男

  大阪大学大学院情報科学研究科

• 橋本 昌宜

  大阪大学大学院情報科学研究科情報システム工学専攻

• 橋本 昌宜

  大阪大

• 尾上 孝雄

  大阪大学大学院情報科学研究科

• 尾上 孝雄

  大阪大学情報科学研究科

• 尾上 孝雄

  大阪大学大学院情報科学研究科情報システム工学専攻

• Onoye Takao

  Faculty Of Engineering Osaka University

• Onoye Takao

  Department Of Communications And Computer Engineering Kyoto University

• Onoye Takao

  Graduate School Of Engineering Osaka University

• 橋本 昌宜

  大阪大学情報科学研究科情報システム工学専攻

• 更田 裕司

  大阪大学大学院情報科学研究科

• Onoye Takao

  Osaka Univ. Suita‐shi Jpn

• 尾上 孝雄

  大阪大学大学院工学研究科情報システム工学専攻

• 密山 幸男

  高知工科大学システム工学群

• 橋本 昌宜

  大阪大学情報科学研究科

• 尾上 孝雄

  京都大学 大学院 情報学研究科 通信情報システム専攻

• Onoye Takao

  Osaka University

• 濱本 浩一

  大阪大学情報科学研究科

• 黒田 弾

  大阪大学大学院情報科学研究科

• 密山 幸男

  大阪大学情報科学研究科

• 密山 幸男

  大阪大学大学院工学研究科

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著作論文

• 低エネルギー動作に適した超低電圧プロセッサのアーキテクチャ評価
• AS-1-4 製造ばらつきや環境変動を許容するサブスレッショルド回路設計(AS-1.サブスレッショルドCMOS回路技術,シンポジウムセッション)
• 低エネルギー動作に適した超低電圧プロセッサのアーキテクチャ評価
• サブスレッショルド回路における基板バイアスを考慮したトランジスタのばらつきモデリングとリングオシレータを用いた検証(低消費電力設計,システムオンシリコンを支える設計技術)
• 基板バイアス印加レイアウト方式の面積効率と速度制御性の評価(低消費電力設計,信号処理,LSI,及び一般)
• 基板バイアス印加レイアウト方式の面積効率と速度制御性の評価(低消費電力設計,信号処理,LSI,及び一般)
• 基板バイアス印加レイアウト方式の面積効率と速度制御性の評価(低消費電力設計,信号処理,LSI,及び一般)
• 低エネルギー動作に適した超低電圧プロセッサのアーキテクチャ評価 (画像工学)
• A-3-17 加算器を用いたsubthreshold回路の設計指針の検討(A-3.VLSI設計技術,一般講演)

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