高分解能D/A変換器の一構成
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概要
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D/A変換器の高分解能(20ビット)化について検討した.一般に,12ビット分解能以上での素子精度は0.02%以下となり,実現が困難となる.そこで,12ビットD/A変換器とΔΣ変調による8ビットの時間的保管を用いた分解能向上手法を採用した.このとき,D/A変換器がグリッチを有すると補間に誤差が生じるため,グリッチ低減が可能なD/A変換器の構成について検討した.
- 1994-09-26
著者
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