g_m/I_D Lookup Table法を基礎としたアナログ回路最適化設計(アナログ,アナデジ混載,RF及びセンサインタフェース回路)
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概要
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本報告では、微細CMOSテクノロジを用いたアナログ回路最適化設計において、解析的設計手法であるg_m/I_D Lookup Table法の有効性を、2つの側面から提案する。1つめは、アナログ回路最適化ツールにおいて、有効な初期値を与えることができること、2つめは、トランジスタのSPICEアナログ・パラメータの検証を実行できることである。前者においては、数値的手法によりデザイン・センタリングとサイジングを実行するツールWiCkeDを用い、g_m/I_D Lookup Table法で最適化されたアナログ回路が有効な初期値を与えることを示し、このツールによる性能改善割合を示すとともに、統合設計環境の提案を行う。後者においては、0.18μm CMOSテクノロジを用いたTEG設計・評価により、実測から得られたg_m/I_D Lookup Tableをシミュレーションと比較し、定義された誤差関数によりパラメータの正当性を定量的に検証し、ディジタル特性への影響を最小化した条件で、アナログ・パラメータを再最適化する手法を提案する。
- 2011-07-14
著者
-
小西 貴之
東北大学
-
桝井 昇一
東北大学
-
加保 貴奈
日本電信電話株式会社NTT未来ねっと研究所
-
加保 貴奈
Ntt
-
桝井 昇一
東北大学 電気通信研究所
-
パトリック ベン
東北大学工学部
-
パトリック ベン
東北大学
-
長嶋 孝晃
東北大学
-
加保 貴奈
NTTみらいねっと研究所
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